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allegro 等长设置的一些做法

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发表于 2011-5-12 14:57 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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本帖最后由 紫菁 于 2017-9-14 14:02 编辑 - {, u% g0 B. C" m! c( i1 ~% q. M

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2 j# B. L: f& J( w+ ^' G8 J更新内容 模型添加与规则设置!
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发表于 2018-5-31 23:45 | 只看该作者
it is a long time for me not to use allegro. I need to pick it up again.

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发表于 2014-8-27 22:47 | 只看该作者
非常好的参考资料,多谢楼主分享

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谢谢楼主的分享,正在学习中

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发表于 2011-5-12 15:14 | 只看该作者
谢谢楼主的分享

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发表于 2011-5-12 17:02 | 只看该作者
看看先。

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发表于 2011-5-12 17:47 | 只看该作者
Xnet pin pair怎么设置??

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发表于 2011-5-12 20:12 | 只看该作者
谢谢楼主的分享,正在学习中

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发表于 2011-5-12 22:43 | 只看该作者
谢谢分享~!

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发表于 2011-5-12 22:50 | 只看该作者
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发表于 2011-5-12 22:56 | 只看该作者
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发表于 2011-5-13 09:51 | 只看该作者
谢谢分享!!!

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 楼主| 发表于 2011-5-13 10:06 | 只看该作者
回复 mcu200689 的帖子7 w* s- ~& ?% a( d+ Y, |+ h

8 i7 ?  C( P: V! p) E+ C8 \0 H" X' | / k  ]: P  R3 Q4 s

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发表于 2011-5-13 10:38 | 只看该作者
回复 dsws 的帖子( C- |* o( ?9 n- h5 ^

. T' M% u1 s5 i7 b; v6 F% e4 S# f一直是加了模型做等长,现在做ddr2的地址线也就是一个DSP拖几个DDR2,一根地址线网络有很多DDR2之间的pin pair 这是用不到的,需要的只是DSP一端到DDR2芯片的pin pair,自己做的模型 不能应用到ECSet显示的红色 不知道是怎么回事。。。。

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 楼主| 发表于 2011-5-13 11:06 | 只看该作者
回复 mcu200689 的帖子
  b3 r# T8 ?2 H: h& \! V( _8 _  @  M$ }2 t6 \( [4 y. y" F
给你做个参考 1 拖4的!+ I6 C0 L- L; M8 r: m2 B
1拖四的参考.rar (449.37 KB, 下载次数: 708)
/ a4 {) K: P. U$ `# p

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发表于 2011-5-13 11:11 | 只看该作者
设点到点,每个网络有8路

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发表于 2011-5-13 11:15 | 只看该作者
谢谢分享
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