原帖由 liyabing 于 2008-4-17 16:11 发表4 a5 X7 F8 ?* J# C' N8 R, F0 e
敢问各位大侠,小弟近日使用Capture CIS进行原理图设计,完成后输出网表,并想通过Allegro进行PCB设计。但& }" b* w% W8 |7 X
Allegro输入网表后,出错,显示如下:
Problems with device 'MC74LCX125_0_14PIN, TSSOP_IC_MC'. JEDEC_ ...
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