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标题:
arm的stackup设计讨论
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作者:
legendarrow
时间:
2010-5-8 03:00
标题:
arm的stackup设计讨论
现在做一块arm(PXA310)的板子,里面有要求比较多的阻抗控制,DDR, USB, bluetooth,还有一根天线
3 n' x7 O' a* o `5 i# T
" O! ]$ f" x6 L- z! {- H3 X' {
8层板,
top/gnd/in1/vcc/gnd/in2/vcc1/bottom
(个人想法,欢迎拍砖,当然也是参考比较典型的8层stackup)
5 G B$ { N' g3 |* n" S, q/ A
/ E0 V" e0 V( Y, r. W8 j& P- ?
Guideline要求DDR的microstrip 阻抗控制在90 ohm, stripline阻抗控制在60 ohm,给出的线宽为3/4,姑且不去讨论制造工艺,一条net表层和内层的阻抗不一致肯定是不允许的,是我理解错误,还是guideline有问题呢,下面是guideline的stackup,注意是6层板的,表层的线都没有参考层面了,如何做阻抗控制,有图为证
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2010-5-8 02:46 上传
$ O& x! {/ I1 X U J
1 u( r, J' ]7 s
现在认为guideline是不靠谱的,需要自己做一个stackup,综合USB差分阻抗90 Ohm,(单线也就大概40多吧),DDR的不靠谱的阻抗控制,应该如何设计stackup呢。以前没有做过类似工作,请教一下做stackup的基本流程,或者是一个大致的思路,具体的计算我再慢慢来。
5 L( I; t5 H* O4 p
电源阻抗有计算方法吗,还是说依靠经验做完了再做仿真没问题就OK
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* M6 b; ~) g6 F8 G1 @2 g% B
作者:
legendarrow
时间:
2010-5-8 21:56
顶起,大家看下
作者:
mening
时间:
2010-5-11 09:24
确实不靠谱
作者:
232704482
时间:
2010-5-11 10:05
DDDDDDDDDDDDDDDDDD
作者:
CAD_SI
时间:
2010-5-13 00:10
layer1参考layer3
作者:
loveb771
时间:
2010-6-2 11:41
有图有真相
! m& i9 k/ ?5 }6 c- N
4 b1 Q) K4 z- v; L
8层板,top/gnd/in1/vcc/gnd/in2/vcc1/bottom
2 I4 R9 t. O( p3 n
/ M/ `! }: n" b5 J6 Z/ F1 V" i
这个为什么不设置成:top/gnd/in1/vcc/
vcc1
/in2/
gnd1
/bottom??
作者:
legendarrow
时间:
2010-6-2 14:10
这样子电源与地相隔太远,电源阻抗比较大,无论哪一层做主电源层都很有问题。我的想法是VCC1的主要处理一些很难处理的电源,很多还是留给地,然后in2和bottom走一些不是很重要的线,重要的线下面再加上GND
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