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标题:
Rename allegro—>orcad
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作者:
liulinjievvv
时间:
2008-4-6 19:59
标题:
Rename allegro—>orcad
allegro中的元件rename之后,
. O& i( U" e' t, b" \" \! c
如何将Rename信息反馈到orcad,
* n. j5 ~2 i/ d9 J3 A
以便原理图与PCB同步?
3 F9 q9 P/ _2 e( u {
请高手指点,谢谢了!!!
作者:
elmma
时间:
2008-4-7 10:32
我没有做过,但在书上看到.回注就可以了.你不妨试试
' w8 X0 f! P0 C0 }! I9 J
1.选择file-export-logic.弹出"export logic"对话框,在"logic type"中选择"design entry cis",表示要传回的软件为capture.在"export drectory"中选择要导出的路径.
. m% ^: P6 v0 b1 G4 c
2.单击"other"页面,在:comparision design"栏显示要导出的电路板文件.
0 ?) G3 `1 Q0 ~ U/ |4 G
3.切换到"candece"页面单击"export cadence"按钮.弹出进度窗口.
; ~( m: c x% v9 R ?1 P0 B# A ~: F
4.单击"close",关闭对话框.
4 d$ b) ~9 L; q* H9 z9 X
5.打开design entry cis,打开dsn文件,选择tools-back annotate,在"allegro pcb editor"栏保存好的allegro电路板的路径.
& U9 ^) w* R; d
在netlist栏选择"capture"直接转allegro的netlist路径;
/ Y* `7 h. |6 D" y( |7 s
在"output"栏选择要输出的rename的文件路径.
1 W( ~7 B$ p0 }3 V0 G
bank annotation 两个选项都选上.
; N. @5 U' ?7 a( i3 Q# R6 ?: F$ m6 E
6.单击确定执行back annotate.
作者:
kxx27
时间:
2008-4-7 11:16
提示:
作者被禁止或删除 内容自动屏蔽
作者:
tnttnp
时间:
2008-4-7 14:42
上面的方法我看过，不过没试过。
z% c( I0 g" J' s/ r
我是这样做的，同时打开orcad和allegro，想改那个命名了，高亮这个器件，然后看orcad里哪个被高亮了，然后在orcad里改，改好更新下网表就好了。个人感觉这样似乎要稍微好点
作者:
liulinjievvv
时间:
2008-4-8 22:42
谢谢高手指点！
作者:
windy.yang
时间:
2009-8-28 16:40
终于找到了，要赶紧试试
作者:
黑月
时间:
2010-12-25 15:43
回复
tnttnp
的帖子
4 }* Y; u/ {( _
3 i2 a+ x- F+ p' R. o! ^6 `
你这种方法也是可行的，不过如何器件都布局连线好了，重新导入下网表，原来的器件就会删除，需要重新布线的！
9 _/ {/ O* R% E/ _, S8 r
不知道我这样理解对吧？
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