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如何对比orcad和allegro的网表?以确认是否有原理改动?

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发表于 2016-12-22 08:32 | 只看该作者 回帖奖励 |倒序浏览 |阅读模式

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如何对比orcad和allegro的网表?以确认是否有原理改动?/ \* D" v5 ~' E5 G3 _2 [
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发表于 2016-12-22 11:03 | 只看该作者
brd直接导入网表  看下有没有drc之类的 器件没放的就知道啦

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发表于 2016-12-22 10:01 | 只看该作者
orcad有比较两份原理图的功能。如果非要用原理图和PCB对比,可以直接导网表过去,看log或者有无飞线之类的判断

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orcad怎么比较啊?  详情 回复 发表于 2016-12-23 11:18

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发表于 2016-12-22 13:29 | 只看该作者
到网标是最简单粗暴的方法

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发表于 2016-12-23 11:18 | 只看该作者
amaryllis 发表于 2016-12-22 10:01
  v* W: u1 ^" H0 c/ y6 Jorcad有比较两份原理图的功能。如果非要用原理图和PCB对比,可以直接导网表过去,看log或者有无飞线之类的 ...
! d7 \( D, u1 I7 A- b% b
orcad怎么比较啊?" T- |3 j% }  D

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最新版本tools-compare designs 现在cadence不是主要工具,只装了最新版本,16.6或者16.5是否支持不记得了。  详情 回复 发表于 2017-1-3 09:54

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发表于 2016-12-23 13:53 | 只看该作者
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发表于 2016-12-26 09:27 | 只看该作者
简单粗暴的最好!

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发表于 2016-12-27 17:18 | 只看该作者
1.直接把新原理图导网表到PCB中,如果没有飞线,没有DRC,应该就没有改变。$ j8 C4 w+ N3 g7 G) g
2.如果执行步骤1你还不放心,那么就可以用最新导过网表的PCB和以前的PCB做个对比,如果有差异的话,会直接出一个对比报告。EDA365 skill中有个Netlist Compare。对比。

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发表于 2017-1-3 09:54 | 只看该作者
zuoanwind 发表于 2016-12-23 11:18
' @" e, f& B, ~1 t# s- Q  v  Oorcad怎么比较啊?
! I  a( x4 N; _
最新版本tools-compare designs
. x( S1 k# ^4 Z$ H% ?% i  Z2 V# L/ h# o; u5 ]) S
现在cadence不是主要工具,只装了最新版本,16.6或者16.5是否支持不记得了。7 r3 W8 _# p3 f: E# I; A
# d. A/ L3 F. O5 G

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16.6没有找到这个功能  详情 回复 发表于 2017-1-7 10:11

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发表于 2017-1-7 10:11 | 只看该作者
amaryllis 发表于 2017-1-3 09:54
0 Q8 G# ^8 F, b* T% n" B: Q1 M最新版本tools-compare designs) V. k$ ]( r" u* i7 d, n5 B0 u
0 d: `% u6 [, X5 [- c1 t5 Y
现在cadence不是主要工具,只装了最新版本,16.6或者16.5是否支持不记 ...
* b6 ]' g0 ]3 t" e4 i7 |9 ?
16.6没有找到这个功能
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