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标题: System SI进行DDR仿真的问题 [打印本页]

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作者: guan_zhichao    时间: 2015-8-19 16:54
标题: System SI进行DDR仿真的问题
      我在用system SI进行DDR仿真的时候，ibs模型已经S参数都已经加载后，在 check signal connectivity一步，点击后，报错。见附件。
& D) q& I7 _0 X      请教各位大神，是哪里出了问题？  另外，port11，port12,16  名称是如何定义的？我都不知道问题往哪里定位。
4 ]0 h! U* l, E' O6 s; R. Y* B       救命啊，搞了好几天了。快崩溃了。
' i3 G, J& U( k% i4 }

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2015-8-19 16:52 上传

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作者: qingdalj    时间: 2015-8-19 17:19
首先，仿真路径最好不要有中文，因为有些软件会出错；其次，你的port定义有问题，检查一下你的port

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作者: cousins    时间: 2015-8-20 08:20
解决方法很简单，11,12,16,17,18这5个port你一定是设置了一模一样的正馈和负馈。删掉4个或者按照自己的需要修改下正馈或负馈就可以了。
6 i' z2 U. @6 n+ Y; c3 H( H

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作者: guan_zhichao    时间: 2015-8-24 20:13

qingdalj 发表于 2015-8-19 17:19
) k6 k) n# U6 Z2 X# |首先，仿真路径最好不要有中文，因为有些软件会出错；其次，你的port定义有问题，检查一下你的port

$ e8 _6 J! z0 `' u, t1 R4 \   谢谢大神，我搞了好几天，终于找到问题在哪里了。添加VRM端口的时候，跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数，只看S11，波形是正常的。就忽略了。 非常感谢大神指点！

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作者: guan_zhichao    时间: 2015-8-24 20:13

cousins 发表于 2015-8-20 08:20
  y4 i; \- Q: o; C! \解决方法很简单，11,12,16,17,18这5个port你一定是设置了一模一样的正馈和负馈。删掉4个或者按照自己的需要 ...

9 q& \+ d3 S4 ~3 Y& a7 S     谢谢大神，我搞了好几天，终于找到问题在哪里了。添加VRM端口的时候，跟VDD_1.5V设置成了同样的正反馈。由于提取的S参数，只看S11，波形是正常的。就忽略了。 非常感谢大神指点！
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